Soutenance de thèse - "Utilisation de langages de construction matérielle pour une exploration flexible des espaces de conception sur FPGA"

Ma soutenance de thèse pour l'obtention du grade de docteur de l'Université Grenoble Alpes a eu lieu le mercredi 23 mars 2022 devant le jury constitué de:

Ces travaux ont été menés dans l'équipe System Level Synthesis du laboratoire TIMA, sous la direction de Frédéric Rousseau et la supervision d'Olivier Muller.

Le support de la présentation reste disponible ici (en anglais).

Le manuscrit (en anglais) est disponible ici, et un résumé en français est disponible ici.

Résumé :

Les accélérateurs matériels à base de FPGA s’imposent actuellement comme alternative à haute efficacité énergétique aux processeurs généralistes. Cependant, les méthodologies de développement matériel souffrent d’un grand retard par rapport à leurs pendants logiciels, et des initiatives sont nécessaires afin d’accroire la productivité des concepteurs. Dans cette thèse, nous explorons les possibilités que les nouveaux langages de construction matérielle ouvrent pour le monde de la conception numérique, notamment en permettant l’usage de fonctionnalités de haut niveau. Nous proposons une analyse de différentes métriques et méthodologies d’estimation, et nous intéressons plus particulièrement à ce que ces nouveaux langages peuvent apporter au domaine de l’exploration d’espace de conception. Un logiciel démonstrateur (QECE) est développé et utilisé afin de démontrer l'utilisabilité de notre méthodologie sur différents noyaux applicatifs.


PhD Defense - "Leveraging Hardware Construction Languages for Flexible Design Space Exploration on FPGA"

My thesis defense to obtain the rank of doctor of the Université Grenoble Alpes took place on march 23rd, 2022 before a jury composed of:

This work has been led in the System Level Synthesis team, at TIMA laboratory, and was directed by Frédéric Rousseau and advised by Olivier Muller.

The slides for the presentation can still be found here (in English !).

The thesis itself can be found here.

Abstract :

FPGA based accelerators are imposing themselves as energy efficient alternatives to general purpose CPU. However, hardware developement methodologies are still way behind their software counterparts, and initiatives are to be taken to increase hardware developers productivity. In this thesis, we explore the possibilities that emerging Hardware Construction Languages can bring to the hardware world, notably by leveraging high level features such as functional programming or object oriented development. We start with a comprehensive analysis of estimation metrics and methodologies in the context of FPGA development, and then put a particular focus on how such paradigm can be used for design space exploration, introducing two complementary methodologies — meta design and meta exploration — for such usage. A software demonstrator, QECE, has been developped and used to demonstrate usability of those methodologies in various use cases based on custom made applicative kernels.




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